DDR2 控制信号测试 控制信号过冲测试 控制信号高低电平测试
DDR2总线与工作流程
以通用计算机主板上的DDR2总线为例，DDR2信号线可以分为数据、命令、时钟3部分。其中数据线部分主要完成数据传输工作，包括数据线DQ0-63、Data Mask线DM0-7、数据同步线DQS/DQS# (数据同步线可选单端或差分，通过设定内存芯片内部寄存器EMR[1]的A10位进行选择)；命令线部分包括地址线A0-14、Bank选择线BS0-2、行地址选择RAS#、列选择CAS#、写使能WE#、片选CS#、时钟使能CKE及芯片内部终端电阻使能ODT组成，主要完成寻址、组成各种控制命令及内存初始化工作；差分时钟信号线CK/CK#为整个内存芯片工作提供时钟。
所有的信号线中，除了数据线DQ与数据同步线DQS/DQS#为双向信号线外，其余所有信号线均为单向信号线，只能由内存控制器发出信号。
对于电源和地线，内存颗粒上有一个参考电压输入和三组1.8V电源与地线，分别为芯片上的数据端口，锁相环和芯片电路供电。
对于DDR2内存的工作流程可以非常粗略的概括如下：内存系统上电后由内存控制器对内存芯片进行初始化，主要是配置芯片的工作模式寄存器（MRS/EMRS），从而将内存芯片配置为某种特定的工作模式。初始化完成之后内存芯片便进入Idle模式，此时便可接收控制命令将芯片内部某Bank激活，该Bank所在的地址代表了后面读写某个具体内存地址时的行地址。
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更新时间：2024/4/30 14:16:40
标签：DDR2 时钟测试 数据信号测试 |
